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ETD

Archivio digitale delle tesi discusse presso l’Università di Pisa

Tesi etd-09082009-152835


Tipo di tesi
Tesi di laurea specialistica
Autore
BELLI, MATTEO
Indirizzo email
matte.belli@gmail.com
URN
etd-09082009-152835
Titolo
Realizzazione di un classificatore ad alte prestazioni per architetture di monitoraggio distribuite su piattaforma NetFPGA
Dipartimento
INGEGNERIA
Corso di studi
INGEGNERIA DELLE TELECOMUNICAZIONI
Relatori
relatore Procissi, Gregorio
relatore Prof. Giordano, Stefano
Parole chiave
  • verilog
  • finite automata
  • classifier
  • NetFPGA
Data inizio appello
28/09/2009
Consultabilità
Parziale
Data di rilascio
28/09/2049
Riassunto
In questa tesi viene realizzato un classificatore di traffico che utilizza una tipologia di automi a stati finiti di nuova concezione per rappresentare l’insieme delle regole di classificazione. Il progetto comprende anche un modulo che utilizza le informazioni estratte dal classificatore per generare trame batch. La struttura complessiva può diventare il componente di distribuzione primaria per architetture di monitoraggio del traffico distribuite. La piattaforma hardware usata per l’implementazione è la scheda NetFPGA, un dispositivo ideato dall’università di Stanford per sperimentare nuove funzionalità di rete a velocità di linea. L’FPGA viene programmata col supporto di un linguaggio di descrizione dell’hardware, che in questo caso è il Verilog.
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