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Tesi etd-11282005-015926


Thesis type
Tesi di laurea vecchio ordinamento
Author
Cagnacci, Riccardo
URN
etd-11282005-015926
Title
Architetture Configurabili e Ottimizzate per la tolleranza ai guasti nei sistemi con memorie embedded
Struttura
INGEGNERIA
Corso di studi
INGEGNERIA ELETTRONICA
Commissione
relatore Prof. Terreni, Pierangelo
relatore Ing. Mariani, Riccardo
relatore Prof. Fanucci, Luca
Parole chiave
  • scrubbing
  • Hsiao
  • fault
  • fast track
  • Ecc
  • Seu
Data inizio appello
15/12/2005;
Consultabilità
parziale
Data di rilascio
15/12/2045
Riassunto analitico
Uno degli elementi più critici nei sistemi a microprocessore è il “memory system”, ossia l’insieme<br>delle memorie (RAM, ROM, FLASH, etc...) che servono per immagazzinare il programma da<br>eseguire o i relativi dati. Nei sistemi “embedded”, ossia in cui sia il microprocessore che le memorie<br>sono integrate sullo stesso dispositivo a silicio, il problema dell’affidabilità è ancora più sentito in<br>quanto maggiori sono le cause di malfunzionamento.<br>La tesi riguarda lo studio e la realizzazione di una architettura configurabile per la protezione ai<br>guasti (transitori e permanenti) del “memory system”, architettura che sia integrabile in un sistema<br>più composito di protezione dai guasti dell’intero sistema a microprocessore. La tesi trae spunto da<br>un precedente lavoro di intitolato “Architetture innovative tolleranti ai guasti per sistemi con memorie<br>embedded”, nel quale si erano esaminate alcune tecniche di protezione e si era giunti ad una prima<br>soluzione realizzativa.<br>L’obiettivo della tesi è quindi quello di partire da tale base, studiare le soluzioni architetturali che<br>permettano di: integrare efficacemente il meccanismo di protezione con le tecniche di rilevazione di<br>guasti a livello dell’intero sistema; indivudare una architettura innovativa che permetta di risolvere i<br>problemi di aggravio del tempo di accesso tipici delle soluzioni con codici Hamming; studiare e<br>realizzare una soluzione configurabile nell’ottica del partizionamento della memoria in blocchi con<br>codici più o meno intensivi nel senso del numero dei bit aggiuntivi.<br>Si tratta quindi di una tesi in cui saranno trattati gli aspetti generali dell’architettura di un sistema a<br>microprocessore e poi dettagliati quelli relativi al “memory system”.
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