| Tipo di tesi |
Tesi di laurea specialistica |
| Autore |
BELLI, MATTEO
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| Indirizzo email |
matte.belli@gmail.com |
| URN |
etd-09082009-152835 |
| Titolo |
Realizzazione di un classificatore ad alte prestazioni per architetture di monitoraggio distribuite su piattaforma NetFPGA |
| Settore scientifico disciplinare |
INGEGNERIA, FACOLTA' |
| Corso di studi |
INGEGNERIA DELLE TELECOMUNICAZIONI |
| Commissione |
| Nome Commissario |
Qualifica |
| Stefano Giordano |
relatore |
| Gregorio Procissi |
relatore |
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| Parole chiave |
- verilog
- finite automata
- classifier
- NetFPGA
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| Data inizio appello |
2009-09-28 |
| Disponibilità |
mixed |
| Data di rilascio | 2049-09-28 |
Riassunto analitico
In questa tesi viene realizzato un classificatore di traffico che utilizza una tipologia di automi a stati finiti di nuova concezione per rappresentare l’insieme delle regole di classificazione. Il progetto comprende anche un modulo che utilizza le informazioni estratte dal classificatore per generare trame batch. La struttura complessiva può diventare il componente di distribuzione primaria per architetture di monitoraggio del traffico distribuite. La piattaforma hardware usata per l’implementazione è la scheda NetFPGA, un dispositivo ideato dall’università di Stanford per sperimentare nuove funzionalità di rete a velocità di linea. L’FPGA viene programmata col supporto di un linguaggio di descrizione dell’hardware, che in questo caso è il Verilog.
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| File |
| Nome file |
Dimensione |
Tempo di download stimato
(Ore:Minuti:Secondi) |
| 28.8 Modem |
56K Modem |
ISDN (64 Kb) |
ISDN (128 Kb) |
piu' di 128 Kb |
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01_Introduzione.pdf |
70.74 Kb |
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Frontespizio.pdf |
64.50 Kb |
00:00:17 |
00:00:09 |
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